Kannur, , India
VLSI, VHDL VHSIC Hardware Description Language
0 टिप्पणी करें | 16 लोगो ने देखा है | 17 फरवरी 16  | Suparna Thamban
Design of a fast DLMS adaptive filter using carry look ahead adder is presented here. Carry look ahead adder is employed in the adder-tree for partial product accumulation that reduces the overall delay of the design. Moreover, we have proposed an optimized adder-tree structure introducing 4:2 compressors, which provided saving in area-delay product (ADP). The Design is coded in VDHL and simulated through Xilinx ISE Design Suite 13.4.
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